•內(nèi)容力求少而精，在“精練”上取勝。精選內(nèi)容，優(yōu)選講法，以符合教學(xué)基本要求為準(zhǔn)。

•為了解決內(nèi)容多與學(xué)時(shí)緊的矛盾，并突出學(xué)生的個(gè)性培養(yǎng)，在每章的最后設(shè)置輔修內(nèi)容。在學(xué)時(shí)多的情況下，教師也可選講該部分自學(xué)材料，真正做到好教好學(xué)。

•在保證基礎(chǔ)內(nèi)容的前提下，加重中大規(guī)模數(shù)字集成電路的相關(guān)內(nèi)容。

•提出數(shù)字系統(tǒng)的組成的概念，對(duì)數(shù)字系統(tǒng)的模塊化擴(kuò)展、分析與設(shè)計(jì)方法進(jìn)行重點(diǎn)、系統(tǒng)的介紹。

•教材中引入了超高速硬件描述語(yǔ)言VHDL，在相關(guān)章節(jié)的輔修內(nèi)容中給出有關(guān)基本數(shù)字功能器件及數(shù)字系統(tǒng)的VHDL語(yǔ)言描述，便于學(xué)生循序漸進(jìn)地自學(xué)。

“數(shù)字電子技術(shù)基礎(chǔ)”是工科院校電氣電子信息類專業(yè)的一門重要的技術(shù)基礎(chǔ)課，研究各種數(shù)字器件、數(shù)字電路、數(shù)字系統(tǒng)、模數(shù)混合系統(tǒng)的工作原理和分析與設(shè)計(jì)方法。為適應(yīng)電子信息科學(xué)技術(shù)的飛速發(fā)展和21世紀(jì)對(duì)高素質(zhì)創(chuàng)新人才培養(yǎng)的要求，我們結(jié)合多年的教學(xué)實(shí)踐經(jīng)驗(yàn)，編寫了本書。本書具有以下特點(diǎn)：

（1）力求少而精，在“精練”上取勝。精選內(nèi)容，優(yōu)選講法，以符合教學(xué)基本要求為準(zhǔn)。

（2）為了解決內(nèi)容多與學(xué)時(shí)緊的矛盾，并突出學(xué)生的個(gè)性培養(yǎng)，在每一章的最后一節(jié)提供了輔修內(nèi)容。在學(xué)時(shí)多的情況下，教師也可選講該部分內(nèi)容，真正做到好教好學(xué)。

（3）在保證基礎(chǔ)內(nèi)容的前提下，加重中大規(guī)模數(shù)字集成電路的相關(guān)內(nèi)容。

（4）提出數(shù)字系統(tǒng)組成的概念，對(duì)數(shù)字系統(tǒng)的模塊化擴(kuò)展、分析與設(shè)計(jì)方法進(jìn)行重點(diǎn)、系統(tǒng)的介紹。

（5）教材中引入了超高速硬件描述語(yǔ)言VHDL，在相關(guān)章節(jié)的輔修內(nèi)容中給出有關(guān)基本數(shù)字功能器件及數(shù)字系統(tǒng)的VHDL語(yǔ)言描述，便于學(xué)生循序漸進(jìn)地自學(xué)。

本書共有10章。第1章為邏輯代數(shù)基礎(chǔ)，包括邏輯代數(shù)的基本概念、公式定理，邏輯函數(shù)的表示法及化簡(jiǎn)法，VHDL語(yǔ)言基礎(chǔ)；第2章為門電路，包括TTL、CMOS兩種集成門電路的電路結(jié)構(gòu)、工作原理、有關(guān)特性與參數(shù)，重點(diǎn)介紹了三種特殊結(jié)構(gòu)（OC、TSL、TG）數(shù)字集成電路技術(shù)，并涉及門電路的VHDL語(yǔ)言的描述；第3章為組合邏輯電路，包括組合邏輯電路的分析與設(shè)計(jì)方法，重點(diǎn)講述幾種常用的中規(guī)模集成組合邏輯芯片及其VHDL語(yǔ)言的描述；第4章為觸發(fā)器，包括各種不同類型觸發(fā)器的電路結(jié)構(gòu)、動(dòng)作特點(diǎn)、邏輯功能和VHDL語(yǔ)言的描述；第5章為時(shí)序邏輯電路，包括時(shí)序邏輯電路的分析與設(shè)計(jì)方法，側(cè)重介紹幾種常用的中規(guī)模集成時(shí)序邏輯芯片和VHDL語(yǔ)言的描述；第6章為半導(dǎo)體存儲(chǔ)器，包括ROM、RAM的電路結(jié)構(gòu)、工作原理、特點(diǎn)和VHDL語(yǔ)言的描述；第7章為數(shù)字系統(tǒng)的分析與設(shè)計(jì)，介紹數(shù)字系統(tǒng)組成的概念，數(shù)字系統(tǒng)模塊化的分析與設(shè)計(jì)方法，數(shù)字系統(tǒng)的擴(kuò)展方法，VHDL語(yǔ)言在數(shù)字系統(tǒng)模塊化分析與設(shè)計(jì)中的應(yīng)用；第8章為可編程邏輯器件，包括各種可編程邏輯器件的結(jié)構(gòu)、工作原理及特點(diǎn)；第9章為脈沖波形的產(chǎn)生與整形，介紹施密特觸發(fā)器、單穩(wěn)態(tài)觸發(fā)器、多諧振蕩器的特點(diǎn)、作用和電路構(gòu)成；第10章為數(shù)模與模數(shù)轉(zhuǎn)換，包括ADC、DAC的特點(diǎn)、電路構(gòu)成和工作原理等。

本書是在總結(jié)中南大學(xué)信息科學(xué)與工程學(xué)院電工電子教學(xué)與實(shí)驗(yàn)中心教師多年教學(xué)實(shí)踐經(jīng)驗(yàn)的基礎(chǔ)上于2015年完成編寫工作。該書由陳明義任主編，覃愛娜、陳革輝任副主編。其中，覃愛娜負(fù)責(zé)第1章、第2章、第3章的編寫；陳革輝負(fù)責(zé)第4章、第5章、第6章的編寫；陳明義負(fù)責(zé)第7章、第8章、第9章、第10章的編寫。該書在編寫過程中得到了羅桂娥、張亞明、李飛、劉獻(xiàn)如、彭衛(wèi)超、余迪、朱利香等老師的幫助和支持。最后，由陳明義統(tǒng)稿定稿。

本書可作為高等學(xué)校電氣電子信息類專業(yè)“數(shù)字電子技術(shù)基礎(chǔ)”課程的教材，也可作為從事電子技術(shù)的工程技術(shù)人員及廣大電子技術(shù)愛好者的參考書。

本書在編寫過程中得到了全體同仁的大力支持，在此一并表示衷心的感謝。

由于編寫水平有限，加之時(shí)間倉(cāng)促，書中難免有許多不妥與錯(cuò)誤，殷切期望讀者批評(píng)與指正。

前言
第1章 邏輯代數(shù)基礎(chǔ) 1
1.1 邏輯變量和邏輯運(yùn)算 1
1.1.1 邏輯變量 1
1.1.2 基本邏輯運(yùn)算 1
1.1.3 復(fù)合邏輯運(yùn)算 4
1.2 邏輯代數(shù)的公式和定理 6
1.2.1 邏輯代數(shù)的基本公式和常用公式 6
1.2.2 邏輯代數(shù)的基本定理 7
1.3 邏輯函數(shù)及其表示方式 8
1.3.1 邏輯函數(shù)的表示方法 9
1.3.2 邏輯函數(shù)的標(biāo)準(zhǔn)形式 12
1.4 邏輯函數(shù)的公式化簡(jiǎn)法 16
1.4.1 最簡(jiǎn)邏輯式的概念 16
1.4.2 邏輯函數(shù)的公式化簡(jiǎn)法 16
1.5 邏輯函數(shù)的卡諾圖化簡(jiǎn) 18
1.5.1 邏輯函數(shù)的卡諾圖表示法 19
1.5.2 用卡諾圖化簡(jiǎn)邏輯函數(shù) 20
1.6 具有無關(guān)項(xiàng)的邏輯函數(shù)及其化簡(jiǎn) 23
1.6.1 邏輯函數(shù)的無關(guān)項(xiàng) 23
1.6.2 具有無關(guān)項(xiàng)的邏輯函數(shù)的化簡(jiǎn) 24
1.7 邏輯函數(shù)的變換與實(shí)現(xiàn) 25
1.7.1 邏輯函數(shù)的表達(dá)形式 25
1.7.2 邏輯函數(shù)的變換 27
1.8 輔修內(nèi)容 28
1.8.1 數(shù)制和碼制 28
1.8.2 用Q-M法化簡(jiǎn)邏輯函數(shù) 34
1.8.3 VHDL語(yǔ)言基礎(chǔ) 37
本章小結(jié) 43
習(xí)題一 44
第2章 門電路 48
2.1 數(shù)字電路的二值邏輯狀態(tài)表示 48
2.2 半導(dǎo)體器件的開關(guān)特性 49
2.2.1 半導(dǎo)體二極管的開關(guān)特性 49
2.2.2 半導(dǎo)體三極管的開關(guān)特性 51
2.2.3 MOS管的開關(guān)特性 54
2.3 分立元件門電路 56
2.3.1 二極管與門 56
2.3.2 二極管或門 57
2.3.3 晶體三極管非門 58
2.4 TTL集成門電路 59
2.4.1 TTL反相器 59
2.4.2 其他邏輯功能的TTL門電路 68
2.4.3 特殊邏輯功能的TTL門電路 71
2.5 CMOS集成門電路 74
2.5.1 CMOS反相器 74
2.5.2 其他邏輯功能的CMOS門電路 80
2.5.3 特殊邏輯功能的CMOS門電路 83
2.6 輔修內(nèi)容 86
2.6.1 改進(jìn)型的TTL門電路 86
2.6.2 其他類型的雙極型數(shù)字集成電路 90
2.6.3 其他類型的MOS電路 95
2.6.4 邏輯門電路的正確使用 98
2.6.5 門電路的VHDL語(yǔ)言描述 105
本章小結(jié) 111
習(xí)題二 111
第3章 組合邏輯電路 116
3.1 組合邏輯電路的特點(diǎn) 116
3.2 組合邏輯電路的分析 116
3.3 組合邏輯電路的設(shè)計(jì) 120
3.4 若干常用組合邏輯電路及其應(yīng)用 122
3.4.1 編碼器 123
3.4.2 譯碼器 128
3.4.3 加法器 139
3.4.4 數(shù)值比較器 143
3.5 輔修內(nèi)容 146
3.5.1 組合邏輯電路中的競(jìng)爭(zhēng)和冒險(xiǎn) 146
3.5.2 常用組合邏輯電路的VHDL語(yǔ)言描述 148
本章小結(jié) 153
習(xí)題三 154
第4章 觸發(fā)器 158
4.1 概述 158
4.2 觸發(fā)器電路的結(jié)構(gòu)及動(dòng)作特點(diǎn) 159
4.2.1 基本RS觸發(fā)器 159
4.2.2 同步RS觸發(fā)器 161
4.2.3 主從觸發(fā)器 163
4.2.4 邊沿觸發(fā)器 166
4.3 觸發(fā)器的邏輯功能及描述方法 169
4.3.1 觸發(fā)器的邏輯功能及描述 169
4.3.2 觸發(fā)器的電路結(jié)構(gòu)與邏輯功能的關(guān)系 172
4.4 觸發(fā)器邏輯功能的轉(zhuǎn)換 173
4.5 輔修內(nèi)容 175
4.5.1 觸發(fā)器的動(dòng)態(tài)特性 175
4.5.2 觸發(fā)器的VHDL語(yǔ)言描述 177
本章小結(jié) 183
習(xí)題四 184
第5章 時(shí)序邏輯電路 189
5.1 概述 189
5.2 同步時(shí)序邏輯電路的分析 191
5.2.1 同步時(shí)序邏輯電路分析的一般步驟 192
5.2.2 同步時(shí)序邏輯電路的分析舉例 192
5.3 同步時(shí)序邏輯電路的設(shè)計(jì) 196
5.3.1 同步時(shí)序邏輯電路設(shè)計(jì)的一般步驟 196
5.3.2 同步時(shí)序邏輯電路設(shè)計(jì)舉例 197
5.4 若干常用時(shí)序邏輯電路及應(yīng)用 203
5.4.1 寄存器和移位寄存器 203
5.4.2 計(jì)數(shù)器 208
5.5 輔修內(nèi)容 225
5.5.1 異步時(shí)序邏輯電路的分析 225
5.5.2 時(shí)序邏輯電路中的競(jìng)爭(zhēng)與冒險(xiǎn) 227
5.5.3 常用時(shí)序邏輯電路的VHDL語(yǔ)言描述 230
本章小結(jié) 233
習(xí)題五 234
第6章 半導(dǎo)體存儲(chǔ)器 238
6.1 概述 238
6.2 只讀存儲(chǔ)器 240
6.2.1 掩膜只讀存儲(chǔ)器 240
6.2.2 可編程只讀存儲(chǔ)器（PROM） 242
6.2.3 可擦除的可編程只讀存儲(chǔ)器（EPROM） 244
6.2.4 EPROM集成芯片簡(jiǎn)介 247
6.3 隨機(jī)存儲(chǔ)器 248
6.3.1 靜態(tài)隨機(jī)存儲(chǔ)器 249
6.3.2 動(dòng)態(tài)隨機(jī)存儲(chǔ)器 253
6.4 存儲(chǔ)器的應(yīng)用 257
6.4.1 作函數(shù)運(yùn)算表電路 257
6.4.2 實(shí)現(xiàn)任意組合邏輯函數(shù) 259
6.5 輔修內(nèi)容 264
6.5.1 順序存取存儲(chǔ)器（SAM） 264
6.5.2 存儲(chǔ)器的VHDL語(yǔ)言描述 268
本章小結(jié) 270
習(xí)題六 271
第7章 數(shù)字系統(tǒng)的分析與設(shè)計(jì) 273
7.1 概述 273
7.2 數(shù)字系統(tǒng)的擴(kuò)展 274
7.2.1 中規(guī)模集成組合邏輯電路的功能擴(kuò)展 274
7.2.2 中規(guī)模集成時(shí)序邏輯電路的功能擴(kuò)展 277
7.2.3 存儲(chǔ)器容量的擴(kuò)展 280
7.3 數(shù)字系統(tǒng)的分析 282
7.4 數(shù)字系統(tǒng)的設(shè)計(jì) 288
7.5 輔修內(nèi)容 291
7.5.1 鍵盤編碼器的分析 291
7.5.2 數(shù)字時(shí)鐘電路的設(shè)計(jì) 296
7.5.3 簡(jiǎn)易交通信號(hào)燈控制電路的設(shè)計(jì) 309
本章小結(jié) 315
習(xí)題七 316
第8章 可編程邏輯器件 321
8.1 概述 321
8.2 現(xiàn)場(chǎng)可編程邏輯陣列（FPLA） 324
8.3 可編程陣列邏輯（PAL） 326
8.3.1 PAL器件的基本結(jié)構(gòu) 326
8.3.2 PAL器件的類型 327
8.3.3 PAL器件的應(yīng)用實(shí)例 328
8.4 通用陣列邏輯（GAL） 332
8.4.1 GAL器件的基本結(jié)構(gòu) 332
8.4.2 GAL的行地址映射圖 337
8.5 輔修內(nèi)容 339
8.5.1 高密度可編程邏輯器件（HDPLD） 339
8.5.2 可編程邏輯器件的開發(fā)與編程 351
本章小結(jié) 356
習(xí)題八 357
第9章 脈沖波形的產(chǎn)生與整形 361
9.1 概述 361
9.2 施密特觸發(fā)器 362
9.2.1 用門電路組成的施密特觸發(fā)器 362
9.2.2 施密特觸發(fā)器的應(yīng)用 365
9.3 單穩(wěn)態(tài)觸發(fā)器 367
9.3.1 微分型單穩(wěn)態(tài)觸發(fā)器 367
9.3.2 積分型單穩(wěn)態(tài)觸發(fā)器 370
9.4 多諧振蕩器 372
9.4.1 對(duì)稱式多諧振蕩器 372
9.4.2 石英晶體多諧振蕩器 376
9.5 555定時(shí)器及其應(yīng)用 377
9.5.1 555定時(shí)器的電路結(jié)構(gòu)與功能 377
9.5.2 555定時(shí)器構(gòu)成的施密特觸發(fā)器 379
9.5.3 555定時(shí)器構(gòu)成的單穩(wěn)態(tài)觸發(fā)器 380
9.5.4 555定時(shí)器構(gòu)成的多諧振蕩器 382
9.6 輔修內(nèi)容 385
9.6.1 集成施密特觸發(fā)器 385
9.6.2 集成單穩(wěn)態(tài)觸發(fā)器 389
9.6.3 壓控振蕩器 394
本章小結(jié) 399
習(xí)題九 400
第10章 數(shù)模與模數(shù)轉(zhuǎn)換 404
10.1 概述 404
10.1.1 ADC與DAC的應(yīng)用 404
10.1.2 ADC與DAC的性能指標(biāo) 406
10.1.3 ADC與DAC的分類 406
10.2 數(shù)模轉(zhuǎn)換器（DAC） 406
10.2.1 數(shù)模轉(zhuǎn)換原理與一般組成 406
10.2.2 權(quán)電阻網(wǎng)絡(luò)DAC 408
10.2.3 R-2R倒T形電阻網(wǎng)絡(luò)DAC 411
10.2.4 DAC的轉(zhuǎn)換精度與轉(zhuǎn)換速度 413
10.3 模數(shù)轉(zhuǎn)換器（ADC） 416
10.3.1 模數(shù)轉(zhuǎn)換基本原理 416
10.3.2 并聯(lián)比較型ADC 419
10.3.3 逐次逼近型ADC 422
10.3.4 雙積分型ADC 424
10.3.5 ADC的轉(zhuǎn)換精度和轉(zhuǎn)換速度 428
10.4 輔修內(nèi)容 429
10.4.1 集成DAC 429
10.4.2 集成ADC 434
本章小結(jié) 440
習(xí)題十 440
參考文獻(xiàn) 445

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2. 數(shù)字電子技術(shù) [主編 覃愛娜]
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5. 模擬電子技術(shù)（第二版） [主編 羅桂娥]
6. 電工電子技術(shù)實(shí)驗(yàn)指導(dǎo)書 [主編 李翠英 聶玲 魏 鋼 羅]
7. 電工電子技術(shù) [主編 吳培剛 許弟建]
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22. 電工與電子技術(shù)基礎(chǔ)（第二版） [苑尚尊]
23. 模擬電子技術(shù) [羅桂娥]
24. 電子技術(shù)（第二版） [李中發(fā) 羅瑞瓊]
25. 電工與電子技術(shù)基礎(chǔ)實(shí)驗(yàn)指導(dǎo)書（第二版） [李翠英 石 巖 ]
26. 電工與電子技術(shù) [主編 李燕]
27. 模擬電子技術(shù)基礎(chǔ) [何碧貴 韓德勛]
28. 實(shí)用電子技術(shù)與電子創(chuàng)新設(shè)計(jì) [劉磊 劉延武 郭紅英]
29. 數(shù)字電子技術(shù)案例教程 [主 編 劉曉陽(yáng) 王平]
30. 電工電子技術(shù)基礎(chǔ)（第二版） [李中發(fā)]